Ⅰ.考查目標(biāo)

考察考生對(duì)數(shù)字電子技術(shù)的基本知識(shí)、基本分析方法和基本技能的掌握情況，要求考生具有較強(qiáng)的電子技術(shù)應(yīng)用能力和相關(guān)技能，深層次考察考生數(shù)字電子技術(shù)相關(guān)知識(shí)去分析和解決生產(chǎn)生活中實(shí)際問(wèn)題的能力。

II.考試形式和試卷結(jié)構(gòu)

一、試卷及考試時(shí)間

本試卷為 150 分，考試時(shí)間為 180 分鐘。

二、答題方式

答題方式為閉卷、筆試。

三、試卷題型結(jié)構(gòu)

單選題(40~50 分)、簡(jiǎn)答題(10~20 分)、計(jì)算題(20~30 分)和綜合分析題(50~60 分)

Ⅲ.考查內(nèi)容

1、邏輯代數(shù)基礎(chǔ)

掌握掌握數(shù)字電路與數(shù)字信號(hào)的概念與特點(diǎn);掌握數(shù)制及其互相轉(zhuǎn)換、二進(jìn)制數(shù)的算術(shù)運(yùn)算、碼制及常用編碼;掌握邏輯函數(shù)的概念及邏輯問(wèn)題描述方法; 掌握邏輯代數(shù)基本定律與定理及邏輯函數(shù)的代數(shù)化簡(jiǎn)法和卡諾圖化簡(jiǎn)法。

2、門電路

掌握正負(fù)邏輯的概念;掌握 TTL 和 CMOS 基本門電路的結(jié)構(gòu)、原理、邏輯功能、技術(shù)參數(shù)和使用方法;掌握三態(tài)門、OC 門、OD 門及 CMOS 傳輸門的特性及用途;了解各種門電路之間的接口問(wèn)題。

3、組合邏輯電路

掌握組合邏輯電路的特點(diǎn)、分析方法和設(shè)計(jì)方法;掌握常用集成組合邏輯器件(編碼器、譯碼器、數(shù)據(jù)選擇器、加法器、數(shù)據(jù)比較器)的邏輯功能及使用方法，能夠利用集成組合邏輯器件分析設(shè)計(jì)組合邏輯電路;正確理解組合邏輯電路的競(jìng)爭(zhēng)冒險(xiǎn)現(xiàn)象及其消除方法。

4、鎖存器和觸發(fā)器

掌握各種鎖存器觸發(fā)器的電路結(jié)構(gòu)與動(dòng)作特點(diǎn);掌握各種鎖存器觸發(fā)器的邏輯功能、描述方法及不同類型觸發(fā)器之間的相互轉(zhuǎn)換;了解觸發(fā)器的動(dòng)態(tài)特性。

5、時(shí)序邏輯電路

掌握時(shí)序邏輯電路的概念、特點(diǎn)及其描述方法;掌握同步和異步時(shí)序邏輯電路的分析;掌握同步時(shí)序邏輯電路的設(shè)計(jì);掌握計(jì)數(shù)器、寄存器等常用時(shí)序電路的工作原理、邏輯功能及使用方法;掌握用中規(guī)模集成計(jì)數(shù)器構(gòu)成任意進(jìn)制計(jì)數(shù)器的設(shè)計(jì)和分析方法。

6、脈沖的產(chǎn)生與整形

掌握施密特觸發(fā)電路、單穩(wěn)態(tài)觸發(fā)電路和多諧振蕩電路的電路結(jié)構(gòu)、工作原理、電路特性、電路應(yīng)用及電路參數(shù)的計(jì)算;掌握 555 定時(shí)器的工作原理及構(gòu)成施密特觸發(fā)電路、單穩(wěn)態(tài)觸發(fā)電路和多諧振蕩電路的方法及電路參數(shù)的計(jì)算。

7、半導(dǎo)體存儲(chǔ)器及可編程邏輯器件

理解存儲(chǔ)器的分類及只讀存儲(chǔ)器 ROM、隨機(jī)存取存儲(chǔ)器 RAM 的電路結(jié)構(gòu)和工作原理;掌握存儲(chǔ)器容量的計(jì)算和擴(kuò)展存儲(chǔ)容量的方法;掌握用存儲(chǔ)器實(shí)現(xiàn)組合邏輯函數(shù)的方法;了解可編程邏輯器件的種類、工作原理﹑基本結(jié)構(gòu)與特性。

8、數(shù)/模和模/數(shù)轉(zhuǎn)換

了解 D/A、A/D 轉(zhuǎn)換器的類型，掌握 A/D、D/A 轉(zhuǎn)換器的工作原理、主要參數(shù)和使用方法;理解常見(jiàn)的 D/A 和 A/D 轉(zhuǎn)換器的電路組成、工作原理、特點(diǎn)及應(yīng)用。

IV、參考書目

電子技術(shù)基礎(chǔ)，數(shù)字部分(第 5 版)，高等教育出版社，康華光

電工學(xué)下冊(cè)(電子技術(shù))(第 7 版)，高等教育出版社，秦曾煌

附件：

《803數(shù)字電子技術(shù)基礎(chǔ)》考試大綱.pdf

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